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【台大 CVSD / VLSI】徵 Verilog／EDA 實作家教

時薪 $1000 ~ $2000

 / 

線上教學

1月前
  • 短期
  • 需試教

刊登案主

黃先生

家教需求

  • 【教學項目】：Verilog／Digital IC Design／EDA Tools／VLSI 實作
  • 【教學對象】：大學以上
  • 需求內容
  • 注意：
  • 時間與費用僅供參考，可商量，且家教只要一個HW或數個。
  • 目前修習台大電機所 Computer-Aided VLSI System Design（CVSD / EEE5022），希望找熟悉 Verilog、Digital IC Design Flow、EDA tools 的家教協助。課程包含 Verilog-HDL、Synthesis、STA、APR、Verification、HLS、DRC/LVS 等。
  • 目前 Verilog / VLSI 基礎偏初學，希望以實作為主：
  • HW / Lab：協助理解題目、架構設計、Verilog、testbench、simulation、debug；卡住時希望能直接示範完整可執行版本，再逐段教我理解與修改。
  • 期中考：整理重點、考古題／類似題型、易錯觀念與解題技巧。
  • Final Project：希望從 architecture、RTL、verification 到 implementation 全程協助與 code review。課程 Project 為兩人一組、從 RTL 到 GDS。
  • 希望老師有 Digital IC / VLSI 經驗，熟悉 Linux、simulation、synthesis、STA、APR 等流程；修過 CVSD、ICLab 或類似課程尤佳。
  • 以線上螢幕分享、實際看 code、一起 debug為主，希望能一路配合至學期 Final Project 結束。

上課地點

線上教學

上課次數

每週 2 次，每次 2 小時

可選擇上課的時段

每天 13：00 ~ 15：00

需求人數

1人

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